Título
Noise margin and short-circuit current in FGMOS logics
Autor
Luis Fortino Cisneros Sinencio
ALEJANDRO DIAZ SANCHEZ
Jaime Ramírez Angulo
Nivel de Acceso
Acceso Abierto
Materias
Resumen o descripción
Even when floating-gate logics are very-low-voltage circuits, as power supply is reduced, large fan-in FGMOS gates are prone to fail. Thus, determining the negative impact of noise margin and short-circuit current in this type of circuits is crucial to achieve optimal operation for a particular application. For this reason, a systematic and reliable technique for obtaining the correlation between fan-in and supply voltage, simultaneously considering noise margin and short-circuit current, is proposed.
Editor
IEICE Electronics Express
Fecha de publicación
2011
Tipo de publicación
Artículo
Versión de la publicación
Versión aceptada
Recurso de información
Formato
application/pdf
Idioma
Inglés
Audiencia
Estudiantes
Maestros
Público en general
Sugerencia de citación
Cisneros-Sinencio, L.F., et al., (2011). Noise margin and short-circuit current in FGMOS logics, IEICE Electronics Express, Vol. 8 (23): 1967-1971
Repositorio Orígen
Repositorio Institucional del INAOE
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